Area-Efficient Linear Regression Architecture for Real-Time Signal Processing on FPGAs

Royer del Barrio, Pablo; Sánchez Marcos, Miguel Ángel; López Vallejo, Marisa y López Barrio, Carlos Alberto (2011). Area-Efficient Linear Regression Architecture for Real-Time Signal Processing on FPGAs. En: "26th Conference on Design of Circuits and Integrated Systems", 16/11/2011 - 18/11/2011, Albufeira, Portugal.

Descripción

Título: Area-Efficient Linear Regression Architecture for Real-Time Signal Processing on FPGAs
Autor/es:
  • Royer del Barrio, Pablo
  • Sánchez Marcos, Miguel Ángel
  • López Vallejo, Marisa
  • López Barrio, Carlos Alberto
Tipo de Documento: Ponencia en Congreso o Jornada (Artículo)
Título del Evento: 26th Conference on Design of Circuits and Integrated Systems
Fechas del Evento: 16/11/2011 - 18/11/2011
Lugar del Evento: Albufeira, Portugal
Título del Libro: Proceedings of 26th Conference on Design of Circuits and Integrated Systems
Fecha: 2011
Materias:
Escuela: E.T.S.I. Telecomunicación (UPM)
Departamento: Ingeniería Electrónica
Licencias Creative Commons: Reconocimiento - Sin obra derivada - No comercial

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Resumen

Linear regression is a technique widely used in digital signal processing. It consists on finding the linear function that better fits a given set of samples. This paper proposes different hardware architectures for the implementation of the linear regression method on FPGAs, specially targeting area restrictive systems. It saves area at the cost of constraining the lengths of the input signal to some fixed values. We have implemented the proposed scheme in an Automatic Modulation Classifier, meeting the hard real-time constraints this kind of systems have.

Más información

ID de Registro: 12192
Identificador DC: http://oa.upm.es/12192/
Identificador OAI: oai:oa.upm.es:12192
URL Oficial: http://paginas.fe.up.pt/~dcis2011/
Depositado por: Memoria Investigacion
Depositado el: 30 Ago 2012 10:54
Ultima Modificación: 21 Abr 2016 11:23
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