FPGA Implementation of an Adaptive Noise Canceller for Robust Speech Enhancement Interfaces

Rodellar Biarge, M. Victoria; Álvarez Marquina, Agustin; González Concejero, Coral; Gómez Vilda, Pedro y Martinez de Icaya Gomez, M. Elvira (2008). FPGA Implementation of an Adaptive Noise Canceller for Robust Speech Enhancement Interfaces. En: "SPL2008 - IV Southern Conference on Programmable Logic", 26/03/2008-28/03/2008, Patagonia, Argentina. ISBN 978-1-4244-1992-0.

Descripción

Título: FPGA Implementation of an Adaptive Noise Canceller for Robust Speech Enhancement Interfaces
Autor/es:
  • Rodellar Biarge, M. Victoria
  • Álvarez Marquina, Agustin
  • González Concejero, Coral
  • Gómez Vilda, Pedro
  • Martinez de Icaya Gomez, M. Elvira
Tipo de Documento: Ponencia en Congreso o Jornada (Artículo)
Título del Evento: SPL2008 - IV Southern Conference on Programmable Logic
Fechas del Evento: 26/03/2008-28/03/2008
Lugar del Evento: Patagonia, Argentina
Título del Libro: Proceedings of the IV Southern Conference on Programmable Logic, SPL2008
Fecha: 2008
ISBN: 978-1-4244-1992-0
Materias:
Escuela: Facultad de Informática (UPM) [antigua denominación]
Departamento: Arquitectura y Tecnología de Sistemas Informáticos
Licencias Creative Commons: Reconocimiento - Sin obra derivada - No comercial

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Resumen

This paper describes the design and implementation results of an adaptive Noise Canceller useful for the construction of Robust Speech Enhancement Interfaces. The algorithm being used has very good performance for real time applications. Its main disadvantage is the requirement of calculating several operations of division, having a high computational cost. Besides that, the accuracy of the algorithm is critical in fixed-point representation due to the wide range of the upper and lower bounds of the variables implied in the algorithm. To solve this problem, the accuracy is studied and according to the results obtained a specific word-length has been adopted for each variable. The algorithm has been implemented for Altera and Xilinx FPGAs using high level synthesis tools. The results for a fixed format of 40 bits for all the variables and for a specific word-length for each variable are analyzed and discussed.

Más información

ID de Registro: 4677
Identificador DC: http://oa.upm.es/4677/
Identificador OAI: oai:oa.upm.es:4677
URL Oficial: http://www.splconf.org/spl08/
Depositado por: Memoria Investigacion
Depositado el: 25 Oct 2010 08:31
Ultima Modificación: 20 Abr 2016 13:48
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