Entorno de test para la tarjeta de control del equipo de medición de distancias de Indra Sistemas

Cano Moya, Alejandro (2019). Entorno de test para la tarjeta de control del equipo de medición de distancias de Indra Sistemas. Proyecto Fin de Carrera / Trabajo Fin de Grado, E.T.S.I. y Sistemas de Telecomunicación (UPM), Madrid.

Description

Title: Entorno de test para la tarjeta de control del equipo de medición de distancias de Indra Sistemas
Author/s:
  • Cano Moya, Alejandro
Contributor/s:
  • Juárez Martínez, Eduardo
  • Bravo Barahona, Pedro
Item Type: Final Project
Degree: Grado en Ingeniería Electrónica de Comunicaciones
Date: June 2019
Subjects:
Freetext Keywords: Placa de test; Control board
Faculty: E.T.S.I. y Sistemas de Telecomunicación (UPM)
Department: Ingeniería Telemática y Electrónica
Creative Commons Licenses: Recognition - No derivative works - Non commercial

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Abstract

En este documento se propone el diseño de un entorno de test para una tarjeta de control o “control board”, que se compondrá de una placa de test y del código VHDL que se sintetizará para ser volcado en la FPGA de la control board. Dado que en una multinacional el tiempo es dinero, cualquier mejora de producto que le permita detectar fallos superficiales automáticamente hace que se ahorre todo el tiempo y recursos que requeriría la exploración directa a las partes concretas del producto. Por ello, el planteamiento de un diseño de una placa de test que automáticamente detecte fallos de los componentes más importantes de una control board supondría un enorme ahorro. Como la placa de testeo para la control board ha de ser lo menos costosa posible, se aprovecharán todas las funciones posibles de la control board, por lo que el planteamiento inicial de la placa de test será la de una placa que, re-direccionando las distintas entradas y salidas de la control board le permita una autocomprobación de sus distintas partes. Este trabajo de fin de grado concluirá con el diseño a nivel de diagrama de bloques de la placa de test, el desarrollo del código VHDL completo que una vez sintetizado se volcará a la FPGA que contiene la control board y la simulación de la respuesta del producto final en una prueba real. Abstract: In this document, we are going to propose the design of a test environment for a control board, which will consist of a test board and the VHDL code that will be synthesized and programmed into the FPGA control board. Given the fact that in a multinational time is money, any product improvement that allows detecting surface failures automatically saves all the time and resources that a deeper exploration of the specific parts of the product would require. Therefore, the approach of designing a test board that automatically detects failures of the most important components of a control board would be a huge saving. As the test board for the control board has to be as inexpensive as possible, all the possible functions of the control board will be used, so the initial approach of the test board will be that, redirecting the different inputs and outputs of the control board, allow a self-test of its different parts. This end-of-degree project will conclude with the design of the block diagram of the test board, the complete VHDL code that will be downloaded after synthesis to the FPGA contained in the control board and the simulation of the response of the final product in a real test.

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Item ID: 63440
DC Identifier: http://oa.upm.es/63440/
OAI Identifier: oai:oa.upm.es:63440
Deposited by: Biblioteca Universitaria Campus Sur
Deposited on: 09 Aug 2020 06:59
Last Modified: 09 Aug 2020 06:59
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