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Juma Sánchez, Luis and López Serrano, Mario (2021). Diseño, desarrollo e implementación de un circuito integrado reconfigurable para aplicaciones específicas (ASIC) capaz de realizar operaciones criptográficas. Proyecto Fin de Carrera / Trabajo Fin de Grado, E.T.S.I. de Sistemas Informáticos (UPM), Madrid.
Title: | Diseño, desarrollo e implementación de un circuito integrado reconfigurable para aplicaciones específicas (ASIC) capaz de realizar operaciones criptográficas |
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Author/s: |
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Contributor/s: |
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Item Type: | Final Project |
Degree: | Grado en Ingeniería de Computadores |
Date: | July 2021 |
Subjects: | |
Freetext Keywords: | Arquitectura MIPS; Criptografía; Algoritmo RSA |
Faculty: | E.T.S.I. de Sistemas Informáticos (UPM) |
Department: | Sistemas Informáticos |
Creative Commons Licenses: | Recognition - No derivative works - Non commercial |
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El proyecto se basa en el diseño, desarrollo e implementación de un circuito integrado reconfigurable para aplicaciones específicas (ASIC) basado en una arquitectura MIPS que sea capaz de realizar operaciones criptográficas. Más concretamente, se va a implementar el algoritmo RSA para conseguir realizar tanto el cifrado como el descifrado de un determinado texto en claro. Se van a llevar a cabo cada una de las distintas etapas de desarrollo, codificación, usando el llamado lenguaje de descripción hardware, y, posteriormente, se va a realizar la implementación física usando una FPGA (modelo Artix 7-Basys 3). En este punto, se va a usar el lenguaje VHDL y los entornos de desarrollo Vivado y ModelSim. Para lograr el objetivo de añadir las nuevas funcionalidades necesarias a la arquitectura clásica se van a usar diferentes técnicas y algoritmos de computación adquiridos en la escuela por los miembros del grupo.
Abstract:
The project is based on the design, development and implementation of an application-speciffic reconfigurable integrated circuit (ASIC) based on a MIPS architecture that is capable of performing cryptographic operations, more speciffically, the RSA algorithm will be implemented to perform both encryption and decryption of a given plaintext. Each of the different development stages will be carried out, coding using the so-called hardware description language and, subsequently, the physical implementation will be carried out using an FPGA (Artix Model 7-Basys 3). At this point, the VHDL language and the Vivado and ModelSim development environments will be used. In order to achieve the goal of adding the necessary new functionalities to the classical architecture, different computational techniques and algorithms acquired at school by the members of the group will be used.
Item ID: | 68284 |
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DC Identifier: | https://oa.upm.es/68284/ |
OAI Identifier: | oai:oa.upm.es:68284 |
Deposited by: | Biblioteca Universitaria Campus Sur |
Deposited on: | 25 Aug 2021 15:41 |
Last Modified: | 18 Nov 2022 10:05 |