Customizing floating-point units for FPGAs: Area-performance-standard trade-offs

López Vallejo, Marisa y Echeverría Aramendi, Pedro (2011). Customizing floating-point units for FPGAs: Area-performance-standard trade-offs. "Microprocessors And Microsystems", v. 35 (n. 6); pp. 535-546. ISSN 0141-9331. https://doi.org/10.1016/j.micpro.2011.04.004.

Descripción

Título: Customizing floating-point units for FPGAs: Area-performance-standard trade-offs
Autor/es:
  • López Vallejo, Marisa
  • Echeverría Aramendi, Pedro
Tipo de Documento: Artículo
Título de Revista/Publicación: Microprocessors And Microsystems
Fecha: Agosto 2011
Volumen: 35
Materias:
Escuela: E.T.S.I. Telecomunicación (UPM)
Departamento: Ingeniería Electrónica
Licencias Creative Commons: Reconocimiento - Sin obra derivada - No comercial

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Resumen

The high integration density of current nanometer technologies allows the implementation of complex floating-point applications in a single FPGA. In this work the intrinsic complexity of floating-point operators is addressed targeting configurable devices and making design decisions providing the most suitable performance-standard compliance trade-offs. A set of floating-point libraries composed of adder/subtracter, multiplier, divisor, square root, exponential, logarithm and power function are presented. Each library has been designed taking into account special characteristics of current FPGAs, and with this purpose we have adapted the IEEE floating-point standard (software-oriented) to a custom FPGA-oriented format. Extended experimental results validate the design decisions made and prove the usefulness of reducing the format complexity

Más información

ID de Registro: 12150
Identificador DC: http://oa.upm.es/12150/
Identificador OAI: oai:oa.upm.es:12150
Identificador DOI: 10.1016/j.micpro.2011.04.004
Depositado por: Memoria Investigacion
Depositado el: 10 Sep 2012 08:08
Ultima Modificación: 21 Abr 2016 11:20
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