Framework adaptable y reconfigurable dinámicamente para procesamiento de vídeo: aplicación a la etapa de filtrado adaptativo en sistemas de compresión de vídeo H.264/AVC y SVC

Cervero, Teresa; Otero Marnotes, Andres; López, S.; Torre Arnanz, Eduardo de la; Gallicó, G.; Riesgo Alcaide, Teresa y Sarmiento, Roberto (2011). Framework adaptable y reconfigurable dinámicamente para procesamiento de vídeo: aplicación a la etapa de filtrado adaptativo en sistemas de compresión de vídeo H.264/AVC y SVC. En: "XI Jornadas de Computación Reconfigurable y Aplicaciones(JCRA) 2011", 07/09/2011 - 09/09/2011, La Laguna, Tenerife, España. ISBN 9788461488148. pp. 1-6.

Descripción

Título: Framework adaptable y reconfigurable dinámicamente para procesamiento de vídeo: aplicación a la etapa de filtrado adaptativo en sistemas de compresión de vídeo H.264/AVC y SVC
Autor/es:
  • Cervero, Teresa
  • Otero Marnotes, Andres
  • López, S.
  • Torre Arnanz, Eduardo de la
  • Gallicó, G.
  • Riesgo Alcaide, Teresa
  • Sarmiento, Roberto
Tipo de Documento: Ponencia en Congreso o Jornada (Artículo)
Título del Evento: XI Jornadas de Computación Reconfigurable y Aplicaciones(JCRA) 2011
Fechas del Evento: 07/09/2011 - 09/09/2011
Lugar del Evento: La Laguna, Tenerife, España
Título del Libro: Actas de las XI Jornadas de Computación Reconfigurable y Aplicaciones (JCRA) 2011
Fecha: 2011
ISBN: 9788461488148
Materias:
Escuela: E.T.S.I. Industriales (UPM)
Departamento: Automática, Ingeniería Electrónica e Informática Industrial [hasta 2014]
Licencias Creative Commons: Reconocimiento - Sin obra derivada - No comercial

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Resumen

Los sistemas basados en componentes hardware con niveles de paralelismo estático tienden a infrautilizar sus recursos lógicos, ya que se diseñan para soportar el peor escenario posible. Este hecho se acentúa cuando se trabaja con los nuevos estándares de compresión de vídeo, como son el H.264/AVC y el SVC. Estos necesitan soluciones flexibles, capaces de soportar distintos escenarios, y escalables a fin de maximizar la utilización de recursos en todo momento. Por ello, y como alternativa a las soluciones estáticas o multiprocesadoras, este artículo presenta una arquitectura hardware escalable y reconfigurable dinámicamente para el filtrado de bucle adaptativo o Deblocking Filter. Su funcionamiento se basa en el de los arrays sistólicos, y su estrategia de paralelismo maximiza el número de macrobloques que pueden ser procesos simultáneamente.

Más información

ID de Registro: 13339
Identificador DC: http://oa.upm.es/13339/
Identificador OAI: oai:oa.upm.es:13339
URL Oficial: http://jcraconf.org/JCRA2011/
Depositado por: Memoria Investigacion
Depositado el: 25 Oct 2012 07:24
Ultima Modificación: 21 Abr 2016 12:39
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