A hardware mechanism to reduce the energy consumption of the register file of in-order architectures

Ayala Rodrigo, José Luis; López Vallejo, Marisa; López Barrio, Carlos Alberto y Veidenbaum, Alexander (2008). A hardware mechanism to reduce the energy consumption of the register file of in-order architectures. "International Journal of Embedded Systems", v. 3 (n. 4); pp. 285-293. ISSN 1741-1076. https://doi.org/10.1504/IJES.2008.022400.

Descripción

Título: A hardware mechanism to reduce the energy consumption of the register file of in-order architectures
Autor/es:
  • Ayala Rodrigo, José Luis
  • López Vallejo, Marisa
  • López Barrio, Carlos Alberto
  • Veidenbaum, Alexander
Tipo de Documento: Artículo
Título de Revista/Publicación: International Journal of Embedded Systems
Fecha: Julio 2008
Volumen: 3
Materias:
Palabras Clave Informales: register file; in-order; power reduction; predecode; hardware approach.
Escuela: E.T.S.I. Telecomunicación (UPM)
Departamento: Ingeniería Electrónica
Licencias Creative Commons: Reconocimiento - Sin obra derivada - No comercial

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Resumen

This paper introduces an efficient hardware approach to reduce the register file energy consumption by turning unused registers into a low power state. Bypassing the register fields of the fetch instruction to the decode stage allows the identification of registers required by the current instruction (instruction predecode) and allows the control logic to turn them back on. They are put into the low-power state after the instruction use. This technique achieves an 85% energy reduction with no performance penalty.

Más información

ID de Registro: 2785
Identificador DC: http://oa.upm.es/2785/
Identificador OAI: oai:oa.upm.es:2785
Identificador DOI [BETA]: 10.1504/IJES.2008.022400
Depositado por: Memoria Investigacion
Depositado el: 08 Abr 2010 10:41
Ultima Modificación: 20 Abr 2016 12:26
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