Floating-point exponentiation units for reconfigurable computing

Dinechin, Florent de; Echeverría Aramendi, Pedro; López Vallejo, Marisa y Pasca, Bogdan (2013). Floating-point exponentiation units for reconfigurable computing. "ACM Transactions on Reconfigurable Technology and Systems (TRETS)", v. 6 (n. 1); pp. 1-15. ISSN 1936-7406. https://doi.org/10.1145/2457443.2457447.

Descripción

Título: Floating-point exponentiation units for reconfigurable computing
Autor/es:
  • Dinechin, Florent de
  • Echeverría Aramendi, Pedro
  • López Vallejo, Marisa
  • Pasca, Bogdan
Tipo de Documento: Artículo
Título de Revista/Publicación: ACM Transactions on Reconfigurable Technology and Systems (TRETS)
Fecha: Mayo 2013
Volumen: 6
Materias:
Palabras Clave Informales: CCS for this Article, Hardware, Integrated circuits, Logic circuits, Arithmetic and datapath circuits
Escuela: E.T.S.I. Telecomunicación (UPM)
Departamento: Ingeniería Electrónica
Licencias Creative Commons: Reconocimiento - Sin obra derivada - No comercial

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Resumen

The high performance and capacity of current FPGAs makes them suitable as acceleration co-processors. This article studies the implementation, for such accelerators, of the floating-point power function xy as defined by the C99 and IEEE 754-2008 standards, generalized here to arbitrary exponent and mantissa sizes. Last-bit accuracy at the smallest possible cost is obtained thanks to a careful study of the various subcomponents: a floating-point logarithm, a modified floating-point exponential, and a truncated floating-point multiplier. A parameterized architecture generator in the open-source FloPoCo project is presented in details and evaluated.

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ID de Registro: 29552
Identificador DC: http://oa.upm.es/29552/
Identificador OAI: oai:oa.upm.es:29552
Identificador DOI: 10.1145/2457443.2457447
URL Oficial: http://dl.acm.org/citation.cfm?doid=2457443.2457447
Depositado por: Memoria Investigacion
Depositado el: 06 Jul 2014 10:16
Ultima Modificación: 21 Abr 2016 23:57
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